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Sub-sampling PLL Techniques: An Overview

发布日期:2018-11-26 浏览量:6

专用集成电路与系统国家重点实验室

讲座信息


报告人:Prof. Xiang Gao 高翔(浙江大学)

时间:11月28日星期三上午10:30am-11:30am

地点:张江校区微电子楼369会议

Title: Sub-sampling PLL Techniques: An Overview


Abstract: 

PLLs and frequency synthesizers are key building blocks in wireless transceivers for applications like IoT, 5G communication and Automotive Radars. With the trend of higher data-rate, higher carrier frequency and higher order of modulation, the jitter or phase noise requirement becomes more demanding given a limited power budget. This talk discusses the design technique and recent advances of the low jitter sub-sampling PLL architecture . 


Biography: 

高翔博士2004年本科毕业于浙江大学,2010年获荷兰屯特大学Bram Nauta教授组最优等博士学位。2010年至2016年任职于美满电子科技Marvell加州硅谷总部,历任资深工程师,主任工程师,资深主任工程师,首席工程师以及研发经理。2016年至2018年任美国默升科技Credo技术总监。2018年入选浙大百人计划并于8月份加入浙江大学信电学院。现为IEEE 高级会员,领域顶级会议ISSCC学术委员会委员,以及RFIC和CICC的学术委员会委员,在国际知名期刊和会议上发表论文20多篇,其中ISSCC 6篇,持有8项第一发明人美国专利。